TC5203BSE001449R1

更新时间: 2023-10-26

共享DDRSDRAM的读写访问逻辑设计

　　DSP提供下列信号给外部存储器用以完成外部控制：CLK，CS，A0～A15，D0～D15，R／W，MSTRB，ISTRB和IS，但是DDRSDRAM使用的控制信号为：CLK，／CLK，CKE，／CS，／RAS，／CAS，／WE，数据总线DQ0～DQ15和地址总线A0～A11。由于控制信号的不同，因此在DSP和SDRAM的接口电路中需要用逻辑电路根据DSP的命令产生SDRAM的控制信号。正是由于接口电路的这种复杂性，在设计SDRAM和DSP的接口过程中才需要用FPGA来完成。

　　从图3可以看到，FPGA的控制主要包含3个部分：控制寄存器接口、缓冲区接口和SDRAM控制接口。

　　（1）控制寄存器接口　主要包括对DSP地址信号和控制信号的解码；SDRAM的读写模式选择；B0和B1的地址、数据的切换选择及标志控制；读写首末地址的设置等。

　　（2）缓冲区接口　主要代表2个缓冲区B0和B1的相关信号产生，主要有：读写信号；地址信号（ADDR［6－0］）；数据输入输出信号（DATA－IN［15－0］和DATA－OUT［15－0］）等。

　　（3）SDRAM控制接口　产生SDRAM的控制信号、地址信号与数据总线信号，完成SDRAM的3项功能：刷新、读、写。其中读、写主要通过猝发方式进行。由于SDRAM是动态RAM，为了防止数据丢失，必须对其进行动态刷新。在SDRAM控制接口部分设计了专门的刷新电路来完成这项功能。

SDRAM与双DSP的接口框图